[工學(공학) ] 논리회로 - 플립플롭
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작성일 24-05-12 15:47
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[工學(공학) ] 논리회로 - 플립플롭
플립플롭과 래치는 두개의 안정된 상태 중 하나를 가지는 1비트 기억소자
플립-플롭
클럭신호가 Rising 할 때만 출력값이 변함.
Edge-triggered 방식으로 동작
래치
Enable 제어신호가 ‘1’인 동안에 SR입력이 變化(변화)하면 이에 따라 출력(Q)값이 변함
Level-triggered 방식으로 동작함
보통 플립플롭과 래치를 통틀어 플립플롭이라 하는 경우도 있다아
플립플롭 : 동기식 플립플롭
래 치 : 비동기식 플립플롭
1. 플립플롭의 기억용량
2. 플립플롭의 개요와 동작
3. 타이밍관련 매개변수
준비시간과 유지시간전달지연시간
최대 클럭주파수
4. 종류
SR 플립플롭 vs. D 플립플롭JK 플립플롭 vs. T 플립플롭
Master-Slave 플립플롭
플립플롭
쌍안정 상태의 소자로서 기억소자라고도 함. 1비트의 기억용량. 1과 0을 식별해서 기억할 수 있기 때문에 2진 값 소자라 함.
기억용량
플립플롭 4개는 24〓16가지를 식별할 수 있으며, 4비트의 기억용량이 있음.
제어신호
CLK를 만…(drop)
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다.
